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EECS資電 104 F2F3F4
本課程由業界15年經驗,現為力旺電子子公司熵碼科技之研發處處長──吳孟益博士並帶領研發同仁所開設,目的在帶給學生硬體 安全(晶片安全)的入門實戰能力。內容包含晶片安全設計的基礎理論,以及數位設計、FPGA開發驗證的實作與報告,讓學生於 在學期間,便能了解業界對安全的需求及考量,和整個產業生態與實際運作,為進入IC設計產業提早做好準備。
Course keywords: 硬體安全, 晶片安全, 數位設計, FPGA, 積體電路設計 Hardware security, Chip security, Digital design, IC design ● 課程說明(Course Description) 本課程將指導學生如何在積體電路設計的專業基礎上,考量資訊安全需求,進行晶片的數位電路設 計,與FPGA開發驗證,由於實作內容豐富,建議修課學生預先具備C語言能力、基本電子學以及邏輯 設計。 ● 指定用書(Text Books) 投影片教材為主 ● 參考書籍(References) 1. Introduction to Hardware Security and Trust (2012, Springer) 2. Hardware Security - A Hands-on Learning Approach (2018, Elsevier) 3. Understanding Cryptography: A Textbook for Students and Practitioners (2010, Springer) ● 教學方式(Teaching Method) 本課程授課方式為投影片授課輔數位電路設計的實作。學生將會了解設計安全晶片應有的概念及考 量,並獨立完成4次實作作業,其中實作內容含兩部分: 1.數位電路設計(RTL),架構規劃與設計 2.FPGA的開發與驗證 課程設計著重於學生基礎理論的認知,及設計成果的呈現,訓練學生理論與實作並用,以及口頭報 告能力。 ● 教學進度(Syllabus) (暫定,之後會進一步調整) Week Course Description Design Lab week1 學期內容介紹、成績評定。 晶片安全介紹 week2 硬體安全設計、操作 week3 Linux 指令介紹; AES演算法介紹 (線上課程) week4 RTL 語言設計 (Introduction, RTL & test bench語法) week5 RTL 語言設計 (Combinational Logic: blocking); Lab0 week6 Hash 演算法介紹 (線上課程) week7 RTL 語言設計 (Sequential Logic: non-blocking); Lab1 week8 RTL 語言設計 (FSM: moore, mealy) week9 PKC 演算法介紹 (線上課程) week10 期中報告 -1 (AES sub-module with Lab0 and Lab1) week11 RTL 語言設計 (Test Bench: input, DUT, output, compare) week12 RTL 語言設計 (Digital Flow and Synthesis) week13 期中專題報告 -2 (AES架構報告 with Lab2) week14 FPGA 進行設計開發與驗證。 week15 RTL 或 FPGA 實作討論。 week16 Entropy Introduction; 抗攻擊設計 (線上課程) week17 期末報告與討論 (FPGA 合成報告與討論 Lab3) ● 成績考核(Evaluation) 1.LAB0(25%) 2.LAB1(30%) 3.LAB2(30%) 4.LAB3(15%) ● 採用下列何項 AI 使用規則: (3)禁止使用,會人工隨機審查code。 ● 可連結之網頁位址 相關網頁(Personal Website) About us (PUFsecurity) https://www.pufsecurity.com/about-us/
MON | TUE | WED | THU | FRI | |
08:00108:50 | |||||
09:00209:50 | |||||
10:10311:00 | |||||
11:10412:00 | |||||
12:10n13:00 | |||||
13:20514:10 | |||||
14:20615:10 | |||||
15:30716:20 | |||||
16:30817:20 | |||||
17:30918:20 | |||||
18:30a19:20 | |||||
19:30b20:20 | |||||
20:30c21:20 |
Average Percentage 84.92
Std. Deviation 6.51
修課條件: 邏輯電路基礎 (熟悉Multiplexer, Comparator, Counter 等元件)
電機系碩士班博士班,電子所碩士班博士班優先,第3次選課起開放全校修習
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